실험보고서 - Thevenin 등가회로 설계
분야
hwpThevenin의 정리는 전원을 포함한 선형소자들이 직병렬로 복잡하게 연결된 회로망이 있고, 이 회로망의 출력단자에 부하를 연결했을 때 부하에 걸리는 전압과 전류를 이론적으로 또는 실험적으로 쉽게 구할 때 매우 유용하게 적용된다.
Thevenin 등가회로는 회로해석 시 가장 많이 사용되는 이론으로 이번 실험으로 Thevenin등가회로의 원리를 익히고 실제회로에서의 사용법을 알 수 있었다.
2. 실험결과값
실험에 사용되는 저항들의 실측 저항값은 다음과 같았다.
1.2k → 1.1697k
1k → 0.9730k
470 → 467
390 → 384.6
330 → 326.6
3.3k → 3.2526k
2.1) 15V 전압 : 14.987V 로 고정
의 실측 저항값 : 384.6
에 걸리는 전압 : 0.9925V
에 흐르는 전류 계산 :
2.2) (a) 의 측정값 : 4.227V
(b) 의 측정값 : 1.0712k
2.3) 결과값 2.2의 와 을 이용해 Thevenin 등가회로 구성
는 4.22V로, 는 1.0703k로 조정하였다.
에 걸리는 전압 : 0.9854V
에 흐르는 전류 계산 :
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